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【压缩文件】 FPGA

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7010/ZedBoard/视频教程发布/2，Zedboard上运行桌面LINUX.rar 1.2 GB
7010/EBAZ4205/ebit_linux/TF/xillinux-2.0.img.gz 1.2 GB
FPGA/4205启动xillinux系统/xillinux-2.0.img.gz 1.2 GB
7010/4205资料.zip 879.6 MB
ebaz4205-gathered-by-ustcpetergu.zip 801.8 MB
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7010/ZedBoard/视频教程发布/13，PL和PS协同设计实现对OLED的控制.rar 472.3 MB
7010/ZedBoard/视频教程发布/24，VGA接口原理分析以及控制逻辑的实现.rar 458.8 MB
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7010/ZedBoard/视频教程发布/18，多路PWM原理分析以及实现试验.rar 346.2 MB
7010/ZedBoard/视频教程发布/25，纯PL实现独立显存VGA驱动并显示画面.rar 334.7 MB
7010/ZedBoard/视频教程发布/23，QT开发环境的建立以及在ZEDBOARD开发板上运行第一个QT例子.rar 317.1 MB
7010/ZedBoard/视频教程发布/12，学习使用VIO以及进行试验.rar 277.0 MB

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16. Lab 6 - Multiplier/2. BASYS 3 Multiplier Demonstration.mp4 107.3 MB
5. VHDL Coding Structure/3. VHDL Design Architecture Styles.mp4 102.2 MB
11. Lab 1 - Full Adder/2. BASYS 3 Full Adder Demonstration.mp4 92.1 MB
8. FPGA Development Boards/2. BASYS 3 Board Overview.mp4 88.5 MB
17. Lab 7 - RC Servo/2. BASYS 3 RC Servo Demonstration.mp4 85.6 MB
4. VHDL Syntax/2. If Statement Case Statement.mp4 79.9 MB
13. Lab 3 - Universal Shift Register/2. BASYS 3 Universal Shift Register Demonstration.mp4 74.1 MB
4. VHDL Syntax/3. For Loop While Loop.mp4 73.8 MB
13. Lab 3 - Universal Shift Register/4. BASYS 2 Universal Shift Register Solution.mp4 73.0 MB
13. Lab 3 - Universal Shift Register/3. BASYS 2 Universal Shift Register Demonstration.mp4 65.3 MB
16. Lab 6 - Multiplier/3. BASYS 2 Multiplier Demonstration.mp4 64.9 MB
5. VHDL Coding Structure/2. VHDL Design Structure.mp4 63.8 MB
4. VHDL Syntax/6. VHDL Processes and Concurrent Statement.mp4 58.4 MB
2. Introduction/2. Introduction to VHDL.mp4 58.0 MB
3. VHDL Data Types/3. Unsigned Signed Data Types.mp4 49.8 MB
12. Lab 2 - Shift Register/2. BASYS 3 Shift Register Demonstration.mp4 49.1 MB
6. Test Bench/1. Test Benches Introduction.mp4 48.6 MB
14. Lab 4 - 7 Segment Display/3. BASYS 2 - 7 Segment Display Demonstration.mp4 47.6 MB
14. Lab 4 - 7 Segment Display/2. BASYS 3 - 7 Segment Display Demonstration.mp4 46.0 MB
3. VHDL Data Types/2. Signals Variables Constants.mp4 43.6 MB

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